Quartus II：从verilog代码生成原理图框图（bsf文件）
首先说下，为什么用这个功能。
个人习惯顶层用原理图方式绘制，底层模块用verilog代码实现，这样的话在顶层原理图里可以清晰的知道要干啥，比代码更直观。
方法：
File ->Create/Update -> Create Symbol Files for Current File
生成之后就可以在原理图里添加这个模块了
右键 ->Insert -> Symbol
在project里面查找即可。
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